Diseñaré FPGA usando Verilog, SystemVerilog y VHDL en Xilinx Vivado
Acerca de este Servicio
Ofrezco servicios de diseño e implementación de FPGA usando Verilog, System Verilog y VHDL.
Puedo diseñar módulos RTL, depurar proyectos existentes, ejecutar simulaciones y generar bitstreams de Vivado listos para pruebas en hardware.
Tengo experiencia con placas como Artix-7 (Nexys A7), Zynq-7000 (Zybo), Spartan-6 y plataformas FPGA abiertas como Colorlight i9 e IceSugar-Pro.
Mis servicios incluyen:
- diseño y corrección de RTL
- simulación y análisis de formas de onda
- sintetización e implementación en Vivado
- verificación de tiempos
- generación de bitstream y guía para pruebas
Además,
- utilizo las versiones más recientes de Vivado (hasta 2025.2).
- También se pueden soportar flujos de Cadence para proyectos avanzados de pago.
Por favor, contáctame antes de ordenar para confirmar los requisitos.
Plataforma:
FPGA
Otros servicios de Ingeniería electrónica que ofrezco
FAQ
Traducción automática
¿Qué herramientas de FPGA utilizas?
Utilizo Xilinx Vivado (hasta 2025.2) para síntesis, implementación y generación de bitstream, también tengo herramientas de Cadence.
¿Qué idiomas admite?
Trabajo con Verilog, System Verilog y VHDL para diseño y depuración de RTL.
¿Puedes ayudar a ejecutar el diseño en mi placa?
Sí, puedo guiar en el mapeo de pines y proporcionar instrucciones para ejecutar el bitstream en tu placa FPGA.
¿Reparas proyectos de Vivado existentes?
Sí, puedo depurar errores, problemas de tiempos y fallos en la implementación de proyectos existentes.
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playwithsalman

Pakistán
Excellent FPGA engineer, delivered before time, and a clean, timing correct RTL design with the documentation.
Hasta USD50
$
2 días
Tiempo
Útil?
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