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Diseñaré ICs digitales de rtl a gdsii usando cadence
Diseñaré y depuraré módulos RTL en Verilog y SystemVerilog y crearé testbenches
Hola, soy Abdullah Tahir, ingeniero en computación especializado en diseño de IC digital y desarrollo RTL. Trabajo con Verilog, SystemVerilog, lógica digital, simulación y verificación para proyectos ...
Acerca de este Servicio
Hola, soy Abdullah, un profesional en diseño de ICs especializado en implementación de ICs digitales y flujos de trabajo de diseño físico.
Lo que ofrezco:
RTL y síntesis: Revisar RTL en Verilog/SystemVerilog, realizar síntesis y generar netlists e informes.
Diseño físico: Planificación de piso, planificación de energía, colocación, síntesis de árbol de reloj (CTS), enrutamiento y análisis de temporización.
Implementación ASIC: Diseños digitales a nivel de bloque mediante el flujo RTL a GDSII.
Análisis: Informes de temporización, área, congestión y diseño físico para identificar problemas de implementación.
GDSII: Generar datos de layout para proyectos soportados y flujos tecnológicos.
Herramientas:
Cadence Genus
Cadence Innovus
Verilog / SystemVerilog
Diseño de IC digital / ASIC
Me enfoco en una implementación organizada, documentación clara y seguir tus especificaciones y restricciones de diseño.
Por favor, contacta conmigo antes de ordenar proyectos grandes o de chip completo para que pueda revisar el RTL, PDK/tecnología, restricciones y entregables requeridos.
Saludos,
Abdullah Tahir
FAQ
Traducción automática
Q1. ¿Qué incluye tu servicio de RTL a GDSII?
El flujo puede incluir revisión de RTL, síntesis, planificación de piso, planificación de energía, colocación, CTS, enrutamiento, análisis de temporización, verificación física y generación de GDSII, dependiendo del paquete seleccionado y los requisitos del proyecto.
Q2. ¿Puedes trabajar con RTL en Verilog y SystemVerilog?
Sí. Puedo revisar y preparar RTL en Verilog/SystemVerilog para síntesis e implementación de ICs digitales.
Q3. ¿Qué herramientas de Cadence utilizas?
Principalmente trabajo con Cadence Genus para síntesis y Cadence Innovus para diseño físico digital e implementación.
Q4. ¿Puedes realizar síntesis de RTL?
Sí. Puedo sintetizar el RTL proporcionado y analizar el netlist y los informes de síntesis generados.
Q5. ¿Puedes realizar colocación, CTS y enrutamiento?
Sí. Estas etapas de diseño físico están disponibles en los paquetes Estándar y Premium, sujeto a la configuración del proyecto y flujo tecnológico.
Q7. ¿Puedes generar GDSII?
Sí, para proyectos soportados donde la tecnología, bibliotecas, PDK y flujo de implementación requeridos estén disponibles.
Q9. ¿Trabajas en proyectos completos de ASIC o chip completo?
Principalmente trabajo en proyectos de IC digitales a nivel de bloque y de pequeño a mediano tamaño. Por favor, contacta conmigo primero para diseños grandes o de chip completo para que pueda revisar los requisitos.
